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BGA出线方式及等长方法绕线

时间:2014-09-22 17:14:34 来源:鼎华科技 点击: 2554次

等长:

1.走线等长的原因:

绕线一般分为两种情况:其一是在差分对中,为了满足差分信号相位差的要求;其二是在有数据线并行传输的情况下,保证在一个时钟上升或下降沿的时间范围内将所有的数据都能够锁存,确保采集到的数据不发生错位。两种情况都是为了满足走线的等长要求,确保传输数据的准确性。

2.走线等长的方式:

分为绝对等长和相对等长两种,其基本原理是:

绝对等长:即设置一组走线线长控制在某一区域内,例如一组走线10条,每条都设定在1000-2000mil内,是指该组内所有的走线都要控制在本长度范围内,一般应用的有线长限制的情况下;

相对等长:是指在一组走线内部设定一个目标,该目标是本组内部的一条走线,组内其它走线相对于该目标控制在一定的范围内,目标走线一般设置为时钟信号,因为数据传输都是以时钟信号为基准。我们通常使用的等长即为相对等长,两者在本质上是一致的。

3.确保走线等长的方法:

<1>在规则管理器中设置所需要保证等长的所有网络为一个组,在该组内选择目标走线,所有其它的网络的走线长度都是参考到目标网络的走线长度;

<2>为了保证拉通的走线等长,需要进行绕线,在绕线之前需要加上pin_Delay,即芯片内部的时延,因为我们看到的或者画PCB时向外引线的只是封装好的芯片的管脚,在芯片的封装内部,是由很多条走线将管脚连接到die上面的,所以我们从管脚走线之前在芯片内部本身就有一定的长度差,如果不加上这个长度差,所谓的等长就是错误的。

<3>添加pin_Delay的方法是将厂商提供的数据导入到A软件中去,具体方法是:点击Import-Pin delay,选择器件的对应文件,导入之后,打开规则管理器,然后在Analyze-Analysis Modes里面勾选Relative Propagation,并且在Electrical Options里面选中Pin DelayDifferential Pair Constraints选项,如果不选中这两项的话,导入的Pin Delay也不会和我们的走线相加,还是显示没加之前的走线长度,最后打开在线DRC,即On-line DRC,即可以看到规则管理器里面显示走线长度和加上Pin dlay之后的长度,以及与目标走线的长度差;

<4>绕线时首先看目标走线与其它剩余走线之中最长的走线之间的长度差,将最长的走线尽量缩短,直到不能优化为止,然后将目标走线绕长至与目标走线刚好满足要求,之后将需要绕线的网络周边其它走线尽量向四周拉开,留出绕线空间,最后将其它剩余网络绕长至和目标走线满足要求为止;如果目标走线即为最长走线,需要将目标走线尽量缩短,然后将其它走线绕长至满足要求。

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